projekte:3cmplllnb:start
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projekte:3cmplllnb:start [2018/07/21 16:56] – yc | projekte:3cmplllnb:start [2018/07/23 18:48] – [Umsetzung] yc | ||
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In Version 2 wurden die Befestigungslöcher korrigiert und die Bauteile so angeordnet, dass der Originaldeckel verwendet werden kann. | In Version 2 wurden die Befestigungslöcher korrigiert und die Bauteile so angeordnet, dass der Originaldeckel verwendet werden kann. | ||
- | Hier ein Bild der aufgebauten Hardware anstelle des zweiten Downconverters: | + | Hier Bilder |
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Der auf der Leiterplatte befindliche MSP430 programmiert die ADF4002-PLL und rastet damit den 27 MHz-VCXO auf die angelegte 10 MHz-Referenz. Nach erfolgreicher Inbetriebnahme ist eine Abstimmspannung von etwa 1,7 Volt am VCXO zu messen. | Der auf der Leiterplatte befindliche MSP430 programmiert die ADF4002-PLL und rastet damit den 27 MHz-VCXO auf die angelegte 10 MHz-Referenz. Nach erfolgreicher Inbetriebnahme ist eine Abstimmspannung von etwa 1,7 Volt am VCXO zu messen. | ||
- | Um die 27 MHz vom VCXO auf die obere Leiterplatte zu führen kann ein bereits vorgebohrtes Loch einfach ausgebohrt werden. Es empfiehlt sich, hierfür einen 3, | + | Um die 27 MHz vom VCXO auf die obere Leiterplatte zu führen kann ein bereits vorgebohrtes Loch einfach ausgebohrt werden. Es empfiehlt sich, hierfür einen 3, |
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+ | Eine der beim Ausbau gewonnenen Durchkontaktiernieten kann wiederverwendet werden und führt das 27 MHz-Signal nach oben, wo es mit einem kleinen Stück Draht an das naheliegendste Pad des ehemaligen Quarzes geführt wird. Das aufzubohrende Loch ist in der unten stehenden Grafik mit einem Pfeil markiert. | ||
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projekte/3cmplllnb/start.txt · Zuletzt geändert: 2021/09/07 21:06 von thasti